一、單選題：

1、總線周期包含3個時鐘周期，每個總線周期可以傳輸32位數(shù)據(jù)，時鐘頻率為33Mbps，求總線帶寬

2、  SDH相關，光纖的歸一效率V的范圍

3、 諧振功率放大器的集電極Vcc從0增大，功率放大器的狀態(tài)變化(過壓，臨界，欠壓 排序)

二、多選題：

1、MOS管與雙極管相比，有何優(yōu)點

2、verilog中function和task的區(qū)別

3、cache的刷新方式?

4、要想從抽樣信號中恢復出原有信號，應滿足哪些條件?5、常用封裝形式

6、VHDL中的關鍵字bus use now loop

7、網絡協(xié)議包含哪些層，考的應該是ip協(xié)議在哪層?如何應用?

8、Fpga的組成

9、N型半導體摻的雜質 p 、b、sn

10、mp3的數(shù)據(jù)格式

三、判斷題：

1、 廣域網T1，T3標準，T1可以提供1.544Mbps的帶寬 ，T3可以提供45Mbps的帶寬

2、verilog所有語句都能被綜合嗎?

3、兩條平行線的差模、共模定義

四、問答題：

1.fpga系統(tǒng)的設計流程

2.oc門電路和od門電路中的oc，od指的是什么

3.為什么cpu的ram越大dsp的效率越高

4.單片機的最小系統(tǒng)需要哪些東西大題：

一、用verilog編寫2分頻電路

二、兩個8051，分別為A、B，實現(xiàn)A并行采集開關信號，A到B串行通信(2模式)，B并行輸出控制發(fā)光led，畫出其框圖。
 

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